VLSI-Entwurf eines RISC-Prozessors

VLSI-Entwurf eines RISC-Prozessors

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Dieses Lehr- und Arbeitsbuch fA¼hrt in den modernen Entwurf groAŸer Chips ein. Ein groAŸer, leistungsfAchiger RISC-Prozessor wird in einer Hardware-Beschreibungssprache (HDL) spezifiziert, hierarchisch entwickelt und schlieAŸlich als Gattermodell dem Halbleiterhersteller zur Fertigung A¼bergeben. Das Ergebnis ist ein Semi-Custom-Prozessor mit A¼ber 100.000 Bruttogattern und einer Rechenleistung von bis zu 40 MIPS. Das Buch mit Diskette fA¼hrt auch ausfA¼hrlich in die HDL VERILOG ein.Die Schnittstelle des Moduls SMC faAŸt Tabelle 7.24 zusammen. Signal I/O | Beschreibung HIT in | Hit von BTC oder MPC SERIAL_MODE | in | serieller Modus WORK IF in | IFU aktiv n RESET in | Reset des Prozessors CP in | Systemtakt NOanbsp;...


Title:VLSI-Entwurf eines RISC-Prozessors
Author: Ulrich Golze
Publisher:Springer-Verlag - 2013-11-21
ISBN-13:

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